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帮忙看一下这个简单的Verilog写的状态机为什么波形图出不来？
帮忙看一下这个简单的Verilog写的状态机为什么波形图出不来？
2025-03-22 07:31:27
推荐回答（2个）
回答1：
对产生时钟的方法怀疑，你修改另一种写法，clk<=~clk，再试试
回答2：
tb时标呢？
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